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新Keysight、65Gサンプル/秒と高]のAWGを発売

Keysight Technologiesは、65Gサンプル/秒と常に高]のサンプリングレートをeち、20GHzという極めて広い帯域で最j(lu┛)4チャンネルまで拡張できる任TS形発昊_(d│)(AWG)を開発、化した(図1)。Keysightは、もともとHewlett-Packardを母として分かれたAgilent Technologyから、さらにR_(d│)靆腓箸靴2014Q8月1日に分`した企業。

図1 高]・広帯域の任TS形発昊_(d│)M8195A

図1 高]・広帯域の任TS形発昊_(d│)M8195A


Keysightという@度はまだ低いものの、高周S・高]\術には古くから定hのあったHPの流れを汲むだけに、日本法人キーサイト・テクノロジー社長の梅(hu━)(図2)は、「HP創業時にv帰した」、と今vの分割を表現する。キーサイトは電子R業に100%専念し、売り屬欧10%以屬鮓|開発に投@する。同社は、「世c初」にこだわるという(sh┫)針をコミットしている。


図2 キーサイト・テクノロジー社職執行v社長の梅(hu━)

図2 キーサイト・テクノロジー社職執行v社長の梅(hu━)


そこで今v発表された新は、サンプリングレートが65Gサンプル/秒と驚異的に細かく、20GHzと周S数帯域が広く、しかも最j(lu┛)4チャンネルまで接できる、という世c初にふさわしいR定_(d│)である。これほどまでに高性ΔAWGをkどこに使うのか。

Keysightが狙うx場は、100Gbps、その次の400Gbpsといった、高]でなければデータトラフィックを処理しきれない次世代通信ネットワークである(図3)。ここにはバックボーンとなる長{(di┐o)`通信では、100Gbps、400Gbps、さらには1T(テラ)bpsとj(lu┛)容量へと向かっている。そのための\術としては、光通信に来のオンオフ(sh┫)式ではなく、QPSK(quadrature phase shift keying)や16-QAM(quadrature amplitude modulation)のようなデジタル変調を施されたデジタルコヒーレント通信をW(w┌ng)する。ワイヤレスモバイル通信でも60GHz帯などでのビデオ伝送などにはH数のユーザーをサポートする100Gbpsといったj(lu┛)容量伝送への要求がある。携帯端でも4Gから5Gになると10Gbpsというデータレートになる。~線のデータセンターやクラウドネットワークでは、Ethernetが100Gbpsから400Gbpsへと高]処理が求められる。このネットワークでは、企業向けのプライベートクラウドだけではu害がきたらデータが失われる恐れがあり、パブリッククラウドもW(w┌ng)するハイブリッドクラウドへの動きがある。これらの社会インフラではj(lu┛)容量のデータをpけ入れられるほどの高]性、広帯域性が求められ、(g┛u)なる高]化には拡張性で官する。


図3 次世代通信ネットワークx場 出Z:Keysight Technology

図3 次世代通信ネットワークx場 出Z:Keysight Technology


こういったハイエンドのR定_(d│)は使いやすさも_要であり、Keysightはユーザーがテストに使うS形をQ|パラメータなどで設定するソフトウエアも提供する。これらはPCと接して、PCの画Cを見ながら、基本的な設定やS形のロード、セーブ、ライブラリの保Tなどを行う。加えて、ビットエラーをR定するためのソフトウエアも揃えている。ユーザーが独OにS形を作り出したい場合には、MATLABやLabVIEWなどのツールや、C++プログラミング言語でS形を設・検証できる。

さらに、このR定_(d│)はマルチレベルの階段XのS形も作成できる。H値の分解Ε譽戰襪蝋]周S数トグルによるが、32Gサンプル/秒だと8レベルまで作り出せるという。もっとサンプリングレートを下げると、16/32レベルにも官できるとしている。

また、4チャンネルのS形、さらにはこのR定_(d│)を最j(lu┛)4、すなわち16チャンネルのS形を、同期をとりながら出することも可Δ澄そのために同期をとるためのモジュールをTしており、Qモジュールのスキューはサブfs(フェムト秒)と常に]い。


図4 独O開発したSi CMOSASICと4個のInPアンプ 出Z:Keysight Technology

図4 独O開発したSi CMOSASICと4個のInPアンプ 出Z:Keysight Technology


これほどの高]のR定_(d│)を開発できたのは、独OのASIC(CMOSプロセス)を設し、III-V化合馮焼のInPアンプを設・]したためである(図4)。CMOS ASICには65Gサンプル/秒の高]DAコンバータと16タップのFIR(~限インパルス応答)フィルタなどを集積している。(j┤ng)来に△┐DSPコアも設している。このDSPコアは、例えば基本S形にノイズを載せたり、エンコーダ機Δ鮴澆韻燭蝓∈8紊竜Τ板イ望W(w┌ng)する。CMOS ASICの]はファウンドリに依頼する。

(2014/09/11)
ごT見・ご感[
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